PlatformEarlyInit.h 60 KB

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  1. /*++
  2. Copyright (c) 2004 - 2019, Intel Corporation. All rights reserved.<BR>
  3. SPDX-License-Identifier: BSD-2-Clause-Patent
  4. Module Name:
  5. PlatformEarlyInit.h
  6. Abstract:
  7. Platform Early Stage header file
  8. --*/
  9. /*++
  10. This file contains an 'Intel Peripheral Driver' and is
  11. licensed for Intel CPUs and chipsets under the terms of your
  12. license agreement with Intel or your vendor. This file may
  13. be modified by the user, subject to additional terms of the
  14. license agreement
  15. --*/
  16. #ifndef _EFI_PLATFORM_EARLY_INIT_H_
  17. #define _EFI_PLATFORM_EARLY_INIT_H_
  18. #define EFI_FORWARD_DECLARATION(x) typedef struct _##x x
  19. #include <PiPei.h>
  20. #include "PlatformBaseAddresses.h"
  21. #include "PchAccess.h"
  22. #include "VlvAccess.h"
  23. #include "SetupMode.h"
  24. #include "PlatformBootMode.h"
  25. #include "Platform.h"
  26. #include "LegacySpeaker.h"
  27. #include <Ppi/Stall.h>
  28. #include <Guid/PlatformInfo.h>
  29. #include <Guid/SetupVariable.h>
  30. #include <Ppi/AtaController.h>
  31. #include <Ppi/BootInRecoveryMode.h>
  32. #include <Ppi/ReadOnlyVariable2.h>
  33. #include <Ppi/Capsule.h>
  34. #include <Guid/EfiVpdData.h>
  35. #include <Library/DebugLib.h>
  36. #include <Library/BaseMemoryLib.h>
  37. #include <Library/PcdLib.h>
  38. #include <Library/IoLib.h>
  39. #include <Library/HobLib.h>
  40. #include <Library/BaseLib.h>
  41. #include <Library/PeiServicesLib.h>
  42. #include <Library/MtrrLib.h>
  43. #include <Register/Cpuid.h>
  44. #include <IndustryStandard/Pci22.h>
  45. #include <Ppi/Speaker.h>
  46. #include <Guid/MemoryTypeInformation.h>
  47. #include <Ppi/Cache.h>
  48. #include <Ppi/Smbus2.h>
  49. #include <Library/PchPlatformLib.h>
  50. #include <Ppi/SmbusPolicy.h>
  51. #include <Ppi/Reset.h>
  52. #include <Ppi/EndOfPeiPhase.h>
  53. #include <Ppi/MemoryDiscovered.h>
  54. #include <Ppi/VlvPolicy.h>
  55. #include <Guid/GlobalVariable.h>
  56. #include <Ppi/RecoveryModule.h>
  57. #include <Ppi/DeviceRecoveryModule.h>
  58. #include <Guid/RecoveryDevice.h>
  59. #include <Ppi/MasterBootMode.h>
  60. #include <Guid/PlatformCpuInfo.h>
  61. #include <Guid/OsSelection.h>
  62. #include <Register/Msr.h>
  63. #define SMC_LAN_ON 0x46
  64. #define SMC_LAN_OFF 0x47
  65. #define SMC_DEEP_S3_STS 0xB2
  66. //
  67. // Wake Event Types
  68. //
  69. #define SMBIOS_WAKEUP_TYPE_RESERVED 0x00
  70. #define SMBIOS_WAKEUP_TYPE_OTHERS 0x01
  71. #define SMBIOS_WAKEUP_TYPE_UNKNOWN 0x02
  72. #define SMBIOS_WAKEUP_TYPE_APM_TIMER 0x03
  73. #define SMBIOS_WAKEUP_TYPE_MODEM_RING 0x04
  74. #define SMBIOS_WAKEUP_TYPE_LAN_REMOTE 0x05
  75. #define SMBIOS_WAKEUP_TYPE_POWER_SWITCH 0x06
  76. #define SMBIOS_WAKEUP_TYPE_PCI_PME 0x07
  77. #define SMBIOS_WAKEUP_TYPE_AC_POWER_RESTORED 0x08
  78. //
  79. // Defines for stall ppi
  80. //
  81. #define PEI_STALL_RESOLUTION 1
  82. //
  83. // Used in PEI memory test routines
  84. //
  85. #define MEMORY_TEST_COVER_SPAN 0x40000
  86. #define MEMORY_TEST_PATTERN 0x5A5A5A5A
  87. #define EFI_LOW_BEEP_FREQUENCY 0x31B
  88. #define EFI_HIGH_BEEP_FREQUENCY 0x254
  89. //
  90. // General Purpose Constants
  91. //
  92. #define ICH_ACPI_TIMER_MAX_VALUE 0x1000000 //The timer is 24 bit overflow
  93. //
  94. //
  95. // GPIO Register Settings for ValleyFalls (Tablet)
  96. //
  97. //
  98. // IO Space configyuration registers
  99. // Field Descriptions:
  100. // USE: Defines the pin's usage model: GPIO (G) or Native (N) mode.
  101. // I/O: Defines whether GPIOs are inputs (I) or outputs (O).
  102. // (Note: Only meaningful for pins used as GPIOs.)
  103. // LVL: This field gives you the initial value for "output" GPIO's.
  104. // (Note: The output level is dependent upon whether the pin is inverted.)
  105. // TPE: Defines whether Trigger Positive Edge Enable.
  106. // TNE: Defines whether Trigger Negative Edge Enable.
  107. // WAKE_EN: only support in SUS community
  108. // (Note: Only affects the level sent to the GPE logic and does not
  109. // affect the level read through the GPIO registers.)
  110. //
  111. //
  112. // Memory spcae configuration registers
  113. //
  114. // Field Descriptions:
  115. // PAD releated:
  116. // PAD_CONF0
  117. // PAD_CONF1
  118. // PAD_VAL
  119. // PAD_DFT
  120. //
  121. // Notes:
  122. // 1. N = Native , G = GPIO , I = Input, O = Output, - = BOTH/NOT SURE
  123. //
  124. // Signal UsedAs USE I/O LVL TPE TNE PCONF0 PCONF1 PVAL PDFT
  125. // -------------------------------------------------------------------------------------------------------------------------
  126. // GPIO0 UART1_RXD-L N I - - - cd29h - - -
  127. // GPIO1 UART1_TXD-0 N O - - - cd29h - - -
  128. // *GPIO2 UART1_RTS_B-1 N I - - - cca9h - - -
  129. // *GPIO3 UART1_CTS_B-H N O - - - cca9h - - -
  130. // GPIO4 I2C1_SDA-OD-O N - - - - cca9h - - -
  131. // GPIO5 I2C1_SCL-OD-O N - - - - cca9h - - -
  132. // GPIO6 I2S_SYSCLK-0 N O - - - 8d51h - - -
  133. // GPIO7 I2S_L_R-0 (SP) N O - - - 8cd1h - - -
  134. // GPIO8 I2S_DATA_OUT-0 N O - - - 8cd1h - - -
  135. // GPIO9 I2S_SDATA_IN-L N I - - - 8cd1h - - -
  136. // GPIO10 PCM_CLK-0 N O - - - 8d51h - - -
  137. // GPIO11 PCM_FSYNC-0 (SP) N O - - - 8cd1h - - -
  138. // GPIO12 PCM_DATA_OUT-0 (SP) N O - - - 8cd1h - - -
  139. // GPIO13 PCM_DATA_IN-L N I - - - 8d51h - - -
  140. // GPIO14 SATA_GP0 N - - - - - - - -
  141. // GPIO15 I2C2_SDA-OD-O/I N - - - - ccaah - - -
  142. // GPIO16 SATA_LEDN N O - - - - - - -
  143. // GPIO17 UART2_RTS_B-1 N I - - - cd2ah - - -
  144. // GPIO18 UART2_CTS_B-H N O - - - ccaah - - -
  145. // GPIO19 UART2_RXD-H N I - - - ccaah - - -
  146. // GPIO20 I2C2_SCL-OD-O/I N - - - - ccaah - - -
  147. // GPIO21 **PCIE_CLKREQ4B N - - - - - - - -
  148. // GPIO22 UART2_TXD-0 N O - - - ccaah - - -
  149. // GPIO23 FLEX_CLK_SE1 N - - - - - - - -
  150. // GPIO24 SPI0_SCK-0 N O - - - 8d02h - - -
  151. // GPIO25 SPI0_CS-1 N O - - - 8d02h - - -
  152. // GPIO26 SPI0_MOSI-0 N O - - - 8d02h - - -
  153. // GPIO27 SPI0_MISO-L N I - - - 8d02h - - -
  154. // GPIO28 UART3_RXD-L N I - - - - - - -
  155. // GPIO29 UART3_TXD-0 N O - - - - - - -
  156. // GPIO30 UART4_RXD-L N I - - - - - - -
  157. // GPIO31 UART4_TXD-0 N O - - - - - - -
  158. // GPIO32 SDMMC1_CLK N - - - - 208d51h - - -
  159. // GPIO33 SDMMC1_D0 N - - - - 8cd1h - - -
  160. // GPIO34 SDMMC1_D1 N - - - - 8cd1h - - -
  161. // GPIO35 SDMMC1_D2 N - - - - 8cd1h - - -
  162. // GPIO36 SDMMC1_D3_CD_B N - - - - 8cd1h - - -
  163. // GPIO37 MMC1_D4_SD_WE N - - - - 8cd1h - - -
  164. // GPIO38 MMC1_D5 N - - - - 8cd1h - - -
  165. // GPIO39 MMC1_D6 N - - - - 8cd1h - - -
  166. // GPIO40 MMC1_D7 N - - - - 8cd1h - - -
  167. // GPIO41 SDMMC1_CMD N - - - - 8cd1h - - -
  168. // GPIO42 MMC1_RESET_B N - - - - 208d51h - - -
  169. // GPIO43 SDMMC2_CLK N - - - - 208d51h - - -
  170. // GPIO44 SDMMC2_D0 N - - - - 8cd1h - - -
  171. // GPIO45 SDMMC2_D1 N - - - - 8cd1h - - -
  172. // GPIO46 SDMMC2_D2 N - - - - 8cd1h - - -
  173. // GPIO47 SDMMC2_D3_CD_B N - - - - 8cd1h - - -
  174. // GPIO48 SDMMC2_CMD N - - - - 8cd1h - - -
  175. // GPIO49 SDMMC3_CLK N - - - - 8d51h - - -
  176. // GPIO50 SDMMC3_D0 N - - - - 8cd1h - - -
  177. // GPIO51 SDMMC3_D1 N - - - - 8cd1h - - -
  178. // GPIO52 SDMMC3_D2 N - - - - 8cd1h - - -
  179. // GPIO53 SDMMC3_D3 N - - - - 8cd1h - - -
  180. // GPIO54 SDMMC3_CD_B N - - - - cca9h - - -
  181. // GPIO55 SDMMC3_CMD N - - - - 8cd1h - - -
  182. // GPIO56 SDMMC3_1P8_EN N - - - - cd29h - - -
  183. // GPIO57 LPC_AD0 N - - - - - - - -
  184. // GPIO58 LPC_AD1 N - - - - - - - -
  185. // GPIO59 LPC_AD2 N - - - - - - - -
  186. // GPIO60 LPC_AD3 N - - - - - - - -
  187. // GPIO61 LPC_FRAMEB N O - - - - - - -
  188. // GPIO62 LPC_CLKOUT0 N O - - - - - - -
  189. // GPIO63 LPC_CLKOUT1 N O - - - - - - -
  190. // GPIO64 LPC_CLKRUNB N - - - - - - - -
  191. // GPIO65 SMB_DATA N - - - - - - - -
  192. // GPIO66 SMB_CLK N - - - - - - - -
  193. // GPIO67 SMB_ALERTB N - - - - - - - -
  194. // GPIO68 ILB_SEIRQ N - - - - - - - -
  195. // GPIO69 SPKR N O - - - - - - -
  196. //SUS WELL
  197. //GPIO_SUS0 BT_WAKEUP_VLV N O - - - CCA8h - - -
  198. //GPIO_SUS1 BT_CLOCK_REQ N O - - - CCA8h - - -
  199. //GPIO_SUS2 WIFI_PWR_EN N O - - - CCA8h - - -
  200. //GPIO_SUS3 SD_CARD_PWR_EN N O - - - CD28h - - -
  201. //GPIO_SUS4 GPIO_SUS4 N O - - - CD28h - - -
  202. //GPIO_SUS5 GPIO_SUS5 N O - - - CD28h - - -
  203. //GPIO_SUS6 SUSPWRDNACK N O - - - 8850h - - -
  204. //GPIO_SUS7 PMU_SLP_DDRVTT_B N O - - - 8850h - - -
  205. //GPIO_SUS8 PMU_WAKE_B N O - - - CCA8h - - -
  206. //GPIO_SUS9 PMU_PWRBTN_B N O - - - CCA8h - - -
  207. //GPIO_SUS10 PMU_WAKE_LAN_B N O - - - CCA8h - - -
  208. //GPIO_SUS11 SUS_STAT_B N O - - - C828h - - -
  209. //GPIO_SUS12 GPIO_SUS12 N O - - - C828h - - -
  210. //GPIO_SUS13 USB_OC0_B-20K,H N O - - - CCA8h - - -
  211. //GPIO_SUS14 GPIO_SUS14 N O - - - CCA8h - - -
  212. //GPIO_SUS15 SPI_CS1_B-20K,H N O - - - 8C80h - - -
  213. //GPIO_SUS16 PMU_SUSCLK N O - - - C828h - - -
  214. //
  215. #define VF_TAB_GPIO_USE_SEL_VAL_0_31 0x00000000
  216. #define VF_TAB_GPIO_USE_SEL_VAL_32_63 0x00000000
  217. #define VF_TAB_GPIO_USE_SEL_VAL_64_70 0x00000000
  218. #define VF_TAB_GPIO_USE_SEL_VAL_SUS 0x00000000
  219. //
  220. //1010 --00 0100 01-- 0101 --0- 0001 1010
  221. //
  222. #define VF_TAB_GPIO_IO_SEL_VAL_0_31 0x00000000 // BIT30 | BIT28 | BIT27 | BIT19 | BIT17 | BIT13 | BIT9 | BIT2 | BIT0
  223. #define VF_TAB_GPIO_IO_SEL_VAL_32_63 0x00000000
  224. #define VF_TAB_GPIO_IO_SEL_VAL_64_70 0x00000000
  225. #define VF_TAB_GPIO_IO_SEL_VAL_SUS 0x00000000
  226. #define VF_TAB_GPIO_LVL_VAL_0_31 0x00000000
  227. #define VF_TAB_GPIO_LVL_VAL_32_63 0x00000000
  228. #define VF_TAB_GPIO_LVL_VAL_64_70 0x00000000
  229. #define VF_TAB_GPIO_LVL_VAL_SUS 0x00000000
  230. #define VF_TAB_GPIO_TPE_VAL_0_31 0x00000000
  231. #define VF_TAB_GPIO_TPE_VAL_SUS 0x00000000
  232. #define VF_TAB_GPIO_TNE_VAL_0_31 0x00000000
  233. #define VF_TAB_GPIO_TNE_VAL_SUS 0x00000000
  234. #define VF_TAB_GPIO_TS_VAL_0_31 0x00000000
  235. #define VF_TAB_GPIO_TS_VAL_SUS 0x00000000
  236. //
  237. // Memory space registers
  238. //
  239. //
  240. // CONF0
  241. //
  242. #define VF_TAB_PAD_CONF0_GPIO0 0xcd29
  243. #define VF_TAB_PAD_CONF0_GPIO1 0xcd29
  244. #define VF_TAB_PAD_CONF0_GPIO2 0xcca9
  245. #define VF_TAB_PAD_CONF0_GPIO3 0xcca9
  246. #define VF_TAB_PAD_CONF0_GPIO4 0xcca9
  247. #define VF_TAB_PAD_CONF0_GPIO5 0xcca9
  248. #define VF_TAB_PAD_CONF0_GPIO6 0x8d51
  249. #define VF_TAB_PAD_CONF0_GPIO7 0x8cd1
  250. #define VF_TAB_PAD_CONF0_GPIO8 0x8cd1
  251. #define VF_TAB_PAD_CONF0_GPIO9 0x8cd1
  252. #define VF_TAB_PAD_CONF0_GPIO10 0x8d51
  253. #define VF_TAB_PAD_CONF0_GPIO11 0x8cd1
  254. #define VF_TAB_PAD_CONF0_GPIO12 0x8cd1
  255. #define VF_TAB_PAD_CONF0_GPIO13 0x8d51
  256. #define VF_TAB_PAD_CONF0_GPIO14 0xCCA8
  257. #define VF_TAB_PAD_CONF0_GPIO15 0xccaa
  258. #define VF_TAB_PAD_CONF0_GPIO16 0xC828
  259. #define VF_TAB_PAD_CONF0_GPIO17 0xcd2a
  260. #define VF_TAB_PAD_CONF0_GPIO18 0xccaa
  261. #define VF_TAB_PAD_CONF0_GPIO19 0xccaa
  262. #define VF_TAB_PAD_CONF0_GPIO20 0xccaa
  263. #define VF_TAB_PAD_CONF0_GPIO21 0xCCA9
  264. #define VF_TAB_PAD_CONF0_GPIO22 0xccaa
  265. #define VF_TAB_PAD_CONF0_GPIO23 0xCD2A
  266. #define VF_TAB_PAD_CONF0_GPIO24 0x8d02
  267. #define VF_TAB_PAD_CONF0_GPIO25 0x8d02
  268. #define VF_TAB_PAD_CONF0_GPIO26 0x8d02
  269. #define VF_TAB_PAD_CONF0_GPIO27 0x8d02
  270. #define VF_TAB_PAD_CONF0_GPIO28 0x8D02
  271. #define VF_TAB_PAD_CONF0_GPIO29 0x8D02
  272. #define VF_TAB_PAD_CONF0_GPIO30 0x8D00
  273. #define VF_TAB_PAD_CONF0_GPIO31 0xCD2A
  274. #define VF_TAB_PAD_CONF0_GPIO32 0x208d51
  275. #define VF_TAB_PAD_CONF0_GPIO33 0x8cd1
  276. #define VF_TAB_PAD_CONF0_GPIO34 0x8cd1
  277. #define VF_TAB_PAD_CONF0_GPIO35 0x8cd1
  278. #define VF_TAB_PAD_CONF0_GPIO36 0x8cd1
  279. #define VF_TAB_PAD_CONF0_GPIO37 0x8cd1
  280. #define VF_TAB_PAD_CONF0_GPIO38 0x8cd1
  281. #define VF_TAB_PAD_CONF0_GPIO39 0x8cd1
  282. #define VF_TAB_PAD_CONF0_GPIO40 0x8cd1
  283. #define VF_TAB_PAD_CONF0_GPIO41 0x8cd1
  284. #define VF_TAB_PAD_CONF0_GPIO42 0x208d51
  285. #define VF_TAB_PAD_CONF0_GPIO43 0x208d51
  286. #define VF_TAB_PAD_CONF0_GPIO44 0x8cd1
  287. #define VF_TAB_PAD_CONF0_GPIO45 0x8cd1
  288. #define VF_TAB_PAD_CONF0_GPIO46 0x8cd1
  289. #define VF_TAB_PAD_CONF0_GPIO47 0x8cd1
  290. #define VF_TAB_PAD_CONF0_GPIO48 0x8cd1
  291. #define VF_TAB_PAD_CONF0_GPIO49 0x8d51
  292. #define VF_TAB_PAD_CONF0_GPIO50 0x8cd1
  293. #define VF_TAB_PAD_CONF0_GPIO51 0x8cd1
  294. #define VF_TAB_PAD_CONF0_GPIO52 0x8cd1
  295. #define VF_TAB_PAD_CONF0_GPIO53 0x8cd1
  296. #define VF_TAB_PAD_CONF0_GPIO54 0xcca9
  297. #define VF_TAB_PAD_CONF0_GPIO55 0x8cd1
  298. #define VF_TAB_PAD_CONF0_GPIO56 0xcd29
  299. #define VF_TAB_PAD_CONF0_GPIO57 0x8C80
  300. #define VF_TAB_PAD_CONF0_GPIO58 0x8C80
  301. #define VF_TAB_PAD_CONF0_GPIO59 0x8C80
  302. #define VF_TAB_PAD_CONF0_GPIO60 0x8C80
  303. #define VF_TAB_PAD_CONF0_GPIO61 0x8800
  304. #define VF_TAB_PAD_CONF0_GPIO62 0x8D00
  305. #define VF_TAB_PAD_CONF0_GPIO63 0x8800
  306. #define VF_TAB_PAD_CONF0_GPIO64 0x8800
  307. #define VF_TAB_PAD_CONF0_GPIO65 0xC828
  308. #define VF_TAB_PAD_CONF0_GPIO66 0xC828
  309. #define VF_TAB_PAD_CONF0_GPIO67 0xC828
  310. #define VF_TAB_PAD_CONF0_GPIO68 0xCCA8
  311. #define VF_TAB_PAD_CONF0_GPIO69 0xC828
  312. #define VF_TAB_PAD_CONF0_GPIO70 0xCCA8
  313. //
  314. // PAD_CONF1
  315. //
  316. #define VF_TAB_PAD_CONF1_GPIO0 0x20002
  317. #define VF_TAB_PAD_CONF1_GPIO1 0x20002
  318. #define VF_TAB_PAD_CONF1_GPIO2 0x20002
  319. #define VF_TAB_PAD_CONF1_GPIO3 0x20002
  320. #define VF_TAB_PAD_CONF1_GPIO4 0x20002
  321. #define VF_TAB_PAD_CONF1_GPIO5 0x20002
  322. #define VF_TAB_PAD_CONF1_GPIO6 0x1F000F
  323. #define VF_TAB_PAD_CONF1_GPIO7 0x1F000F
  324. #define VF_TAB_PAD_CONF1_GPIO8 0x1F000F
  325. #define VF_TAB_PAD_CONF1_GPIO9 0x1F000F
  326. #define VF_TAB_PAD_CONF1_GPIO10 0x1F000F
  327. #define VF_TAB_PAD_CONF1_GPIO11 0x1F000F
  328. #define VF_TAB_PAD_CONF1_GPIO12 0x1F000F
  329. #define VF_TAB_PAD_CONF1_GPIO13 0x1F000F
  330. #define VF_TAB_PAD_CONF1_GPIO14 0x20002
  331. #define VF_TAB_PAD_CONF1_GPIO15 0x20002
  332. #define VF_TAB_PAD_CONF1_GPIO16 0x20002
  333. #define VF_TAB_PAD_CONF1_GPIO17 0x20002
  334. #define VF_TAB_PAD_CONF1_GPIO18 0x20002
  335. #define VF_TAB_PAD_CONF1_GPIO19 0x20002
  336. #define VF_TAB_PAD_CONF1_GPIO20 0x20002
  337. #define VF_TAB_PAD_CONF1_GPIO21 0x20002
  338. #define VF_TAB_PAD_CONF1_GPIO22 0x20002
  339. #define VF_TAB_PAD_CONF1_GPIO23 0x20002
  340. #define VF_TAB_PAD_CONF1_GPIO24 0x00000
  341. #define VF_TAB_PAD_CONF1_GPIO25 0x00000
  342. #define VF_TAB_PAD_CONF1_GPIO26 0x00000
  343. #define VF_TAB_PAD_CONF1_GPIO27 0x00000
  344. #define VF_TAB_PAD_CONF1_GPIO28 0x00000
  345. #define VF_TAB_PAD_CONF1_GPIO29 0x00000
  346. #define VF_TAB_PAD_CONF1_GPIO30 0x00000
  347. #define VF_TAB_PAD_CONF1_GPIO31 0x20002
  348. #define VF_TAB_PAD_CONF1_GPIO32 0x00000
  349. #define VF_TAB_PAD_CONF1_GPIO33 0x00000
  350. #define VF_TAB_PAD_CONF1_GPIO34 0x00000
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  352. #define VF_TAB_PAD_CONF1_GPIO36 0x00000
  353. #define VF_TAB_PAD_CONF1_GPIO37 0x00000
  354. #define VF_TAB_PAD_CONF1_GPIO38 0x00000
  355. #define VF_TAB_PAD_CONF1_GPIO39 0x00000
  356. #define VF_TAB_PAD_CONF1_GPIO40 0x00000
  357. #define VF_TAB_PAD_CONF1_GPIO41 0x00000
  358. #define VF_TAB_PAD_CONF1_GPIO42 0x00000
  359. #define VF_TAB_PAD_CONF1_GPIO43 0x00000
  360. #define VF_TAB_PAD_CONF1_GPIO44 0x00000
  361. #define VF_TAB_PAD_CONF1_GPIO45 0x00000
  362. #define VF_TAB_PAD_CONF1_GPIO46 0x00000
  363. #define VF_TAB_PAD_CONF1_GPIO47 0x00000
  364. #define VF_TAB_PAD_CONF1_GPIO48 0x00000
  365. #define VF_TAB_PAD_CONF1_GPIO49 0x00000
  366. #define VF_TAB_PAD_CONF1_GPIO50 0x00000
  367. #define VF_TAB_PAD_CONF1_GPIO51 0x00000
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  370. #define VF_TAB_PAD_CONF1_GPIO54 0x20002
  371. #define VF_TAB_PAD_CONF1_GPIO55 0x00000
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  373. #define VF_TAB_PAD_CONF1_GPIO57 0x00000
  374. #define VF_TAB_PAD_CONF1_GPIO58 0x00000
  375. #define VF_TAB_PAD_CONF1_GPIO59 0x00000
  376. #define VF_TAB_PAD_CONF1_GPIO60 0x00000
  377. #define VF_TAB_PAD_CONF1_GPIO61 0x00000
  378. #define VF_TAB_PAD_CONF1_GPIO62 0x00000
  379. #define VF_TAB_PAD_CONF1_GPIO63 0x00000
  380. #define VF_TAB_PAD_CONF1_GPIO64 0x00000
  381. #define VF_TAB_PAD_CONF1_GPIO65 0x20002
  382. #define VF_TAB_PAD_CONF1_GPIO66 0x20002
  383. #define VF_TAB_PAD_CONF1_GPIO67 0x20002
  384. #define VF_TAB_PAD_CONF1_GPIO68 0x20002
  385. #define VF_TAB_PAD_CONF1_GPIO69 0x20002
  386. #define VF_TAB_PAD_CONF1_GPIO70 0x20002
  387. //
  388. // PAD_VAL
  389. //
  390. #define VF_TAB_PAD_VAL_GPIO0 0x2
  391. #define VF_TAB_PAD_VAL_GPIO1 0x2
  392. #define VF_TAB_PAD_VAL_GPIO2 0x2
  393. #define VF_TAB_PAD_VAL_GPIO3 0x2
  394. #define VF_TAB_PAD_VAL_GPIO4 0x2
  395. #define VF_TAB_PAD_VAL_GPIO5 0x2
  396. #define VF_TAB_PAD_VAL_GPIO6 0x2
  397. #define VF_TAB_PAD_VAL_GPIO7 0x2
  398. #define VF_TAB_PAD_VAL_GPIO8 0x2
  399. #define VF_TAB_PAD_VAL_GPIO9 0x2
  400. #define VF_TAB_PAD_VAL_GPIO10 0x2
  401. #define VF_TAB_PAD_VAL_GPIO11 0x2
  402. #define VF_TAB_PAD_VAL_GPIO12 0x2
  403. #define VF_TAB_PAD_VAL_GPIO13 0x2
  404. #define VF_TAB_PAD_VAL_GPIO14 0x2
  405. #define VF_TAB_PAD_VAL_GPIO15 0x2
  406. #define VF_TAB_PAD_VAL_GPIO16 0x4
  407. #define VF_TAB_PAD_VAL_GPIO17 0x2
  408. #define VF_TAB_PAD_VAL_GPIO18 0x2
  409. #define VF_TAB_PAD_VAL_GPIO19 0x2
  410. #define VF_TAB_PAD_VAL_GPIO20 0x2
  411. #define VF_TAB_PAD_VAL_GPIO21 0x2
  412. #define VF_TAB_PAD_VAL_GPIO22 0x2
  413. #define VF_TAB_PAD_VAL_GPIO23 0x2
  414. #define VF_TAB_PAD_VAL_GPIO24 0x2
  415. #define VF_TAB_PAD_VAL_GPIO25 0x2
  416. #define VF_TAB_PAD_VAL_GPIO26 0x2
  417. #define VF_TAB_PAD_VAL_GPIO27 0x2
  418. #define VF_TAB_PAD_VAL_GPIO28 0x2
  419. #define VF_TAB_PAD_VAL_GPIO29 0x2
  420. #define VF_TAB_PAD_VAL_GPIO30 0x2
  421. #define VF_TAB_PAD_VAL_GPIO31 0x2
  422. #define VF_TAB_PAD_VAL_GPIO32 0x2
  423. #define VF_TAB_PAD_VAL_GPIO33 0x2
  424. #define VF_TAB_PAD_VAL_GPIO34 0x2
  425. #define VF_TAB_PAD_VAL_GPIO35 0x2
  426. #define VF_TAB_PAD_VAL_GPIO36 0x2
  427. #define VF_TAB_PAD_VAL_GPIO37 0x2
  428. #define VF_TAB_PAD_VAL_GPIO38 0x2
  429. #define VF_TAB_PAD_VAL_GPIO39 0x2
  430. #define VF_TAB_PAD_VAL_GPIO40 0x2
  431. #define VF_TAB_PAD_VAL_GPIO41 0x2
  432. #define VF_TAB_PAD_VAL_GPIO42 0x2
  433. #define VF_TAB_PAD_VAL_GPIO43 0x2
  434. #define VF_TAB_PAD_VAL_GPIO44 0x2
  435. #define VF_TAB_PAD_VAL_GPIO45 0x2
  436. #define VF_TAB_PAD_VAL_GPIO46 0x2
  437. #define VF_TAB_PAD_VAL_GPIO47 0x2
  438. #define VF_TAB_PAD_VAL_GPIO48 0x2
  439. #define VF_TAB_PAD_VAL_GPIO49 0x2
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  441. #define VF_TAB_PAD_VAL_GPIO51 0x2
  442. #define VF_TAB_PAD_VAL_GPIO52 0x2
  443. #define VF_TAB_PAD_VAL_GPIO53 0x2
  444. #define VF_TAB_PAD_VAL_GPIO54 0x2
  445. #define VF_TAB_PAD_VAL_GPIO55 0x2
  446. #define VF_TAB_PAD_VAL_GPIO56 0x2
  447. #define VF_TAB_PAD_VAL_GPIO57 0x2
  448. #define VF_TAB_PAD_VAL_GPIO58 0x2
  449. #define VF_TAB_PAD_VAL_GPIO59 0x2
  450. #define VF_TAB_PAD_VAL_GPIO60 0x2
  451. #define VF_TAB_PAD_VAL_GPIO61 0x4
  452. #define VF_TAB_PAD_VAL_GPIO62 0x2
  453. #define VF_TAB_PAD_VAL_GPIO63 0x2
  454. #define VF_TAB_PAD_VAL_GPIO64 0x2
  455. #define VF_TAB_PAD_VAL_GPIO65 0x2
  456. #define VF_TAB_PAD_VAL_GPIO66 0x2
  457. #define VF_TAB_PAD_VAL_GPIO67 0x0
  458. #define VF_TAB_PAD_VAL_GPIO68 0x2
  459. #define VF_TAB_PAD_VAL_GPIO69 0x4
  460. #define VF_TAB_PAD_VAL_GPIO70 0x2
  461. //
  462. // PAD_DFT
  463. //
  464. #define VF_TAB_PAD_DFT_GPIO0 0xC
  465. #define VF_TAB_PAD_DFT_GPIO1 0xC
  466. #define VF_TAB_PAD_DFT_GPIO2 0xC
  467. #define VF_TAB_PAD_DFT_GPIO3 0xC
  468. #define VF_TAB_PAD_DFT_GPIO4 0xC
  469. #define VF_TAB_PAD_DFT_GPIO5 0xC
  470. #define VF_TAB_PAD_DFT_GPIO6 0xC
  471. #define VF_TAB_PAD_DFT_GPIO7 0xC
  472. #define VF_TAB_PAD_DFT_GPIO8 0xC
  473. #define VF_TAB_PAD_DFT_GPIO9 0xC
  474. #define VF_TAB_PAD_DFT_GPIO10 0xC
  475. #define VF_TAB_PAD_DFT_GPIO11 0xC
  476. #define VF_TAB_PAD_DFT_GPIO12 0xC
  477. #define VF_TAB_PAD_DFT_GPIO13 0xC
  478. #define VF_TAB_PAD_DFT_GPIO14 0xC
  479. #define VF_TAB_PAD_DFT_GPIO15 0xC
  480. #define VF_TAB_PAD_DFT_GPIO16 0xC
  481. #define VF_TAB_PAD_DFT_GPIO17 0xC
  482. #define VF_TAB_PAD_DFT_GPIO18 0xC
  483. #define VF_TAB_PAD_DFT_GPIO19 0xC
  484. #define VF_TAB_PAD_DFT_GPIO20 0xC
  485. #define VF_TAB_PAD_DFT_GPIO21 0xC
  486. #define VF_TAB_PAD_DFT_GPIO22 0xC
  487. #define VF_TAB_PAD_DFT_GPIO23 0xC
  488. #define VF_TAB_PAD_DFT_GPIO24 0xC
  489. #define VF_TAB_PAD_DFT_GPIO25 0xC
  490. #define VF_TAB_PAD_DFT_GPIO26 0xC
  491. #define VF_TAB_PAD_DFT_GPIO27 0xC
  492. #define VF_TAB_PAD_DFT_GPIO28 0xC
  493. #define VF_TAB_PAD_DFT_GPIO29 0xC
  494. #define VF_TAB_PAD_DFT_GPIO30 0xC
  495. #define VF_TAB_PAD_DFT_GPIO31 0xC
  496. #define VF_TAB_PAD_DFT_GPIO32 0xC
  497. #define VF_TAB_PAD_DFT_GPIO33 0xC
  498. #define VF_TAB_PAD_DFT_GPIO34 0xC
  499. #define VF_TAB_PAD_DFT_GPIO35 0xC
  500. #define VF_TAB_PAD_DFT_GPIO36 0xC
  501. #define VF_TAB_PAD_DFT_GPIO37 0xC
  502. #define VF_TAB_PAD_DFT_GPIO38 0xC
  503. #define VF_TAB_PAD_DFT_GPIO39 0xC
  504. #define VF_TAB_PAD_DFT_GPIO40 0xC
  505. #define VF_TAB_PAD_DFT_GPIO41 0xC
  506. #define VF_TAB_PAD_DFT_GPIO42 0xC
  507. #define VF_TAB_PAD_DFT_GPIO43 0xC
  508. #define VF_TAB_PAD_DFT_GPIO44 0xC
  509. #define VF_TAB_PAD_DFT_GPIO45 0xC
  510. #define VF_TAB_PAD_DFT_GPIO46 0xC
  511. #define VF_TAB_PAD_DFT_GPIO47 0xC
  512. #define VF_TAB_PAD_DFT_GPIO48 0xC
  513. #define VF_TAB_PAD_DFT_GPIO49 0xC
  514. #define VF_TAB_PAD_DFT_GPIO50 0xC
  515. #define VF_TAB_PAD_DFT_GPIO51 0xC
  516. #define VF_TAB_PAD_DFT_GPIO52 0xC
  517. #define VF_TAB_PAD_DFT_GPIO53 0xC
  518. #define VF_TAB_PAD_DFT_GPIO54 0xC
  519. #define VF_TAB_PAD_DFT_GPIO55 0xC
  520. #define VF_TAB_PAD_DFT_GPIO56 0xC
  521. #define VF_TAB_PAD_DFT_GPIO57 0xC
  522. #define VF_TAB_PAD_DFT_GPIO58 0xC
  523. #define VF_TAB_PAD_DFT_GPIO59 0xC
  524. #define VF_TAB_PAD_DFT_GPIO60 0xC
  525. #define VF_TAB_PAD_DFT_GPIO61 0xC
  526. #define VF_TAB_PAD_DFT_GPIO62 0xC
  527. #define VF_TAB_PAD_DFT_GPIO63 0xC
  528. #define VF_TAB_PAD_DFT_GPIO64 0xC
  529. #define VF_TAB_PAD_DFT_GPIO65 0xC
  530. #define VF_TAB_PAD_DFT_GPIO66 0xC
  531. #define VF_TAB_PAD_DFT_GPIO67 0xC
  532. #define VF_TAB_PAD_DFT_GPIO68 0xC
  533. #define VF_TAB_PAD_DFT_GPIO69 0xC
  534. #define VF_TAB_PAD_DFT_GPIO70 0xC
  535. //
  536. //SUS WELL
  537. //
  538. //
  539. // CONF0
  540. //
  541. #define VF_TAB_PAD_CONF0_GPIO_SUS0 0xCCA8
  542. #define VF_TAB_PAD_CONF0_GPIO_SUS1 0xCCA8
  543. #define VF_TAB_PAD_CONF0_GPIO_SUS2 0xCCA8
  544. #define VF_TAB_PAD_CONF0_GPIO_SUS3 0xCD28
  545. #define VF_TAB_PAD_CONF0_GPIO_SUS4 0xCD28
  546. #define VF_TAB_PAD_CONF0_GPIO_SUS5 0xCD28
  547. #define VF_TAB_PAD_CONF0_GPIO_SUS6 0x8850
  548. #define VF_TAB_PAD_CONF0_GPIO_SUS7 0x8850
  549. #define VF_TAB_PAD_CONF0_GPIO_SUS8 0xCCA8
  550. #define VF_TAB_PAD_CONF0_GPIO_SUS9 0xCCA8
  551. #define VF_TAB_PAD_CONF0_GPIO_SUS10 0xCCA8
  552. #define VF_TAB_PAD_CONF0_GPIO_SUS11 0xC828
  553. #define VF_TAB_PAD_CONF0_GPIO_SUS12 0xC828
  554. #define VF_TAB_PAD_CONF0_GPIO_SUS13 0xCCA8
  555. #define VF_TAB_PAD_CONF0_GPIO_SUS14 0xCCA8
  556. #define VF_TAB_PAD_CONF0_GPIO_SUS15 0x8C80
  557. #define VF_TAB_PAD_CONF0_GPIO_SUS16 0xC828
  558. //
  559. // CONF1
  560. //
  561. #define VF_TAB_PAD_CONF1_GPIO_SUS0 0
  562. #define VF_TAB_PAD_CONF1_GPIO_SUS1 0
  563. #define VF_TAB_PAD_CONF1_GPIO_SUS2 0
  564. #define VF_TAB_PAD_CONF1_GPIO_SUS3 0
  565. #define VF_TAB_PAD_CONF1_GPIO_SUS4 0
  566. #define VF_TAB_PAD_CONF1_GPIO_SUS5 0
  567. #define VF_TAB_PAD_CONF1_GPIO_SUS6 0
  568. #define VF_TAB_PAD_CONF1_GPIO_SUS7 0
  569. #define VF_TAB_PAD_CONF1_GPIO_SUS8 0
  570. #define VF_TAB_PAD_CONF1_GPIO_SUS9 0
  571. #define VF_TAB_PAD_CONF1_GPIO_SUS10 0
  572. #define VF_TAB_PAD_CONF1_GPIO_SUS11 0
  573. #define VF_TAB_PAD_CONF1_GPIO_SUS12 0
  574. #define VF_TAB_PAD_CONF1_GPIO_SUS13 0
  575. #define VF_TAB_PAD_CONF1_GPIO_SUS14 0
  576. #define VF_TAB_PAD_CONF1_GPIO_SUS15 0
  577. #define VF_TAB_PAD_CONF1_GPIO_SUS16 0
  578. //
  579. // PAD_VAL
  580. //
  581. #define VF_TAB_PAD_VAL_GPIO_SUS0 0
  582. #define VF_TAB_PAD_VAL_GPIO_SUS1 0
  583. #define VF_TAB_PAD_VAL_GPIO_SUS2 0
  584. #define VF_TAB_PAD_VAL_GPIO_SUS3 0
  585. #define VF_TAB_PAD_VAL_GPIO_SUS4 0
  586. #define VF_TAB_PAD_VAL_GPIO_SUS5 0
  587. #define VF_TAB_PAD_VAL_GPIO_SUS6 0
  588. #define VF_TAB_PAD_VAL_GPIO_SUS7 0
  589. #define VF_TAB_PAD_VAL_GPIO_SUS8 0
  590. #define VF_TAB_PAD_VAL_GPIO_SUS9 0
  591. #define VF_TAB_PAD_VAL_GPIO_SUS10 0
  592. #define VF_TAB_PAD_VAL_GPIO_SUS11 0
  593. #define VF_TAB_PAD_VAL_GPIO_SUS12 0
  594. #define VF_TAB_PAD_VAL_GPIO_SUS13 0
  595. #define VF_TAB_PAD_VAL_GPIO_SUS14 0
  596. #define VF_TAB_PAD_VAL_GPIO_SUS15 0
  597. #define VF_TAB_PAD_VAL_GPIO_SUS16 0
  598. //
  599. // PAD_DFT
  600. //
  601. #define VF_TAB_PAD_DFT_GPIO_SUS0 0
  602. #define VF_TAB_PAD_DFT_GPIO_SUS1 0
  603. #define VF_TAB_PAD_DFT_GPIO_SUS2 0
  604. #define VF_TAB_PAD_DFT_GPIO_SUS3 0
  605. #define VF_TAB_PAD_DFT_GPIO_SUS4 0
  606. #define VF_TAB_PAD_DFT_GPIO_SUS5 0
  607. #define VF_TAB_PAD_DFT_GPIO_SUS6 0
  608. #define VF_TAB_PAD_DFT_GPIO_SUS7 0
  609. #define VF_TAB_PAD_DFT_GPIO_SUS8 0
  610. #define VF_TAB_PAD_DFT_GPIO_SUS9 0
  611. #define VF_TAB_PAD_DFT_GPIO_SUS10 0
  612. #define VF_TAB_PAD_DFT_GPIO_SUS11 0
  613. #define VF_TAB_PAD_DFT_GPIO_SUS12 0
  614. #define VF_TAB_PAD_DFT_GPIO_SUS13 0
  615. #define VF_TAB_PAD_DFT_GPIO_SUS14 0
  616. #define VF_TAB_PAD_DFT_GPIO_SUS15 0
  617. #define VF_TAB_PAD_DFT_GPIO_SUS16 0
  618. //
  619. //
  620. // GPIO Register Settings for ValleyFalls (Netbook)
  621. //
  622. //
  623. // IO Space configyuration registers
  624. // Field Descriptions:
  625. // USE: Defines the pin's usage model: GPIO (G) or Native (N) mode.
  626. // I/O: Defines whether GPIOs are inputs (I) or outputs (O).
  627. // (Note: Only meaningful for pins used as GPIOs.)
  628. // LVL: This field gives you the initial value for "output" GPIO's.
  629. // (Note: The output level is dependent upon whether the pin is inverted.)
  630. // TPE: Defines whether Trigger Positive Edge Enable.
  631. // TNE: Defines whether Trigger Negative Edge Enable.
  632. // WAKE_EN: only support in SUS community
  633. // (Note: Only affects the level sent to the GPE logic and does not
  634. // affect the level read through the GPIO registers.)
  635. //
  636. //
  637. // Memory spcae configuration registers
  638. //
  639. // Field Descriptions:
  640. // PAD releated:
  641. // PAD_CONF0
  642. // PAD_CONF1
  643. // PAD_VAL
  644. // PAD_DFT
  645. //
  646. // Notes:
  647. // 1. N = Native , G = GPIO , I = Input, O = Output, - = BOTH/NOT SURE
  648. //
  649. // Signal UsedAs USE I/O LVL TPE TNE PCONF0 PCONF1 PVAL PDFT
  650. // -------------------------------------------------------------------------------------------------------------------------
  651. // GPIO0 UART1_RXD-L N I - - - cd29h - - -
  652. // GPIO1 UART1_TXD-0 N O - - - cd29h - - -
  653. // *GPIO2 UART1_RTS_B-1 N I - - - cca9h - - -
  654. // *GPIO3 UART1_CTS_B-H N O - - - cca9h - - -
  655. // GPIO4 NMI_B-H G - - - - cca9h - - -
  656. // GPIO5 GPIO_D5 G - - - - cca9h - - -
  657. // GPIO6 GPIO_D6 G O - - - 8d51h - - -
  658. // GPIO7 GPIO_D7 G O - - - 8cd1h - - -
  659. // GPIO8 GPIO_D8 G O - - - 8cd1h - - -
  660. // GPIO9 GPIO_D9 G I - - - 8cd1h - - -
  661. // GPIO10 GPIO_D10 G O - - - 8d51h - - -
  662. // GPIO11 GPIO_D11 G O - - - 8cd1h - - -
  663. // GPIO12 GPIO_D12 G O - - - 8cd1h - - -
  664. // GPIO13 GPIO_D13 G I - - - 8d51h - - -
  665. // GPIO14 SATA_GP0 N - - - - - - - -
  666. // GPIO15 SATA_GP1-L N - - - - ccaah - - -
  667. // GPIO16 SATA_LEDN-OD-O N O - - - - - - -
  668. // GPIO17 PCIE_CLKREQ0B-20K,H N I - - - cd2ah - - -
  669. // GPIO18 PCIE_CLKREQ1B-20K,H N O - - - ccaah - - -
  670. // GPIO19 PCIE_CLKREQ2B-20K,H N I - - - ccaah - - -
  671. // GPIO20 PCIE_CLKREQ3B-20K,H N - - - - ccaah - - -
  672. // GPIO21 PCIE_CLKREQ4B-20K,H N - - - - - - - -
  673. // GPIO22 FLEX_CLK_SE0-20K,L N O - - - ccaah - - -
  674. // GPIO23 FLEX_CLK_SE1-20K,L N - - - - - - - -
  675. // GPIO24 HDA_RSTB N O - - - 8d02h - - -
  676. // GPIO25 HDA_SYNC N O - - - 8d02h - - -
  677. // GPIO26 HDA_CLK N O - - - 8d02h - - -
  678. // GPIO27 HDA_SDO N I - - - 8d02h - - -
  679. // GPIO28 HDA_SDI0 N I - - - - - - -
  680. // GPIO29 HDA_SDI1 N O - - - - - - -
  681. // GPIO30 HDA_DOCKRSTB N I - - - - - - -
  682. // GPIO31 HDA_DOCKENB N O - - - - - - -
  683. // GPIO32 SDMMC1_CLK N - - - - 208d51h - - -
  684. // GPIO33 SDMMC1_D0 N - - - - 8cd1h - - -
  685. // GPIO34 SDMMC1_D1 N - - - - 8cd1h - - -
  686. // GPIO35 SDMMC1_D2 N - - - - 8cd1h - - -
  687. // GPIO36 SDMMC1_D3_CD_B N - - - - 8cd1h - - -
  688. // GPIO37 MMC1_D4_SD_WE N - - - - 8cd1h - - -
  689. // GPIO38 MMC1_D5 N - - - - 8cd1h - - -
  690. // GPIO39 MMC1_D6 N - - - - 8cd1h - - -
  691. // GPIO40 MMC1_D7 N - - - - 8cd1h - - -
  692. // GPIO41 SDMMC1_CMD N - - - - 8cd1h - - -
  693. // GPIO42 MMC1_RESET_B N - - - - 208d51h - - -
  694. // GPIO43 SDMMC2_CLK N - - - - 208d51h - - -
  695. // GPIO44 SDMMC2_D0 N - - - - 8cd1h - - -
  696. // GPIO45 SDMMC2_D1 N - - - - 8cd1h - - -
  697. // GPIO46 SDMMC2_D2 N - - - - 8cd1h - - -
  698. // GPIO47 SDMMC2_D3_CD_B N - - - - 8cd1h - - -
  699. // GPIO48 SDMMC2_CMD N - - - - 8cd1h - - -
  700. // GPIO49 SDMMC3_CLK N - - - - 8d51h - - -
  701. // GPIO50 SDMMC3_D0 N - - - - 8cd1h - - -
  702. // GPIO51 SDMMC3_D1 N - - - - 8cd1h - - -
  703. // GPIO52 SDMMC3_D2 N - - - - 8cd1h - - -
  704. // GPIO53 SDMMC3_D3 N - - - - 8cd1h - - -
  705. // GPIO54 SDMMC3_CD_B N - - - - cca9h - - -
  706. // GPIO55 SDMMC3_CMD N - - - - 8cd1h - - -
  707. // GPIO56 SDMMC3_1P8_EN N - - - - cd29h - - -
  708. // GPIO57 LPC_AD0 N - - - - - - - -
  709. // GPIO58 LPC_AD1 N - - - - - - - -
  710. // GPIO59 LPC_AD2 N - - - - - - - -
  711. // GPIO60 LPC_AD3 N - - - - - - - -
  712. // GPIO61 LPC_FRAMEB N O - - - - - - -
  713. // GPIO62 LPC_CLKOUT0 N O - - - - - - -
  714. // GPIO63 LPC_CLKOUT1 N O - - - - - - -
  715. // GPIO64 LPC_CLKRUNB N - - - - - - - -
  716. // GPIO65 SMB_DATA N - - - - - - - -
  717. // GPIO66 SMB_CLK N - - - - - - - -
  718. // GPIO67 SMB_ALERTB N - - - - - - - -
  719. // GPIO68 ILB_SEIRQ N - - - - - - - -
  720. // GPIO69 SPKR N O - - - - - - -
  721. //SUS WELL
  722. //GPIO_SUS0 GPIO_SUS0 N O - - - CCA8h - - -
  723. //GPIO_SUS1 GPIO_SUS1 N O - - - CCA8h - - -
  724. //GPIO_SUS2 GPIO_SUS2 N O - - - CCA8h - - -
  725. //GPIO_SUS3 GPIO_SUS3 N O - - - CD28h - - -
  726. //GPIO_SUS4 GPIO_SUS4 N O - - - CD28h - - -
  727. //GPIO_SUS5 GPIO_SUS5 N O - - - CD28h - - -
  728. //GPIO_SUS6 SUSPWRDNACK-0 N O - - - 8850h - - -
  729. //GPIO_SUS7 PMU_SLP_DDRVTT_B-0 N O - - - 8850h - - -
  730. //GPIO_SUS8 PMU_WAKE_B-20K,H N O - - - CCA8h - - -
  731. //GPIO_SUS9 PMU_PWRBTN_B-20K,H N O - - - CCA8h - - -
  732. //GPIO_SUS10 PMU_WAKE_LAN_B-20K,H N O - - - CCA8h - - -
  733. //GPIO_SUS11 SUS_STAT_B-1 N O - - - C828h - - -
  734. //GPIO_SUS12 PMU_SUSCLK-0 N O - - - C828h - - -
  735. //GPIO_SUS13 USB_OC0_B-20K,H N O - - - CCA8h - - -
  736. //GPIO_SUS14 USB_OC1_B-20K,H N O - - - CCA8h - - -
  737. //GPIO_SUS15 SPI_CS1_B-20K,H N O - - - 8C80h - - -
  738. //GPIO_SUS16 SPI_CS1_B-20K,H N O - - - C828h - - -
  739. //
  740. #define VF_NET_GPIO_USE_SEL_VAL_0_31 0x00000000
  741. #define VF_NET_GPIO_USE_SEL_VAL_32_63 0x00000000
  742. #define VF_NET_GPIO_USE_SEL_VAL_64_70 0x00000000
  743. #define VF_NET_GPIO_USE_SEL_VAL_SUS 0x00000000
  744. //
  745. //1010 --00 0100 01-- 0101 --0- 0001 1010
  746. //
  747. #define VF_NET_GPIO_IO_SEL_VAL_0_31 0x00000000 // BIT30 | BIT28 | BIT27 | BIT19 | BIT17 | BIT13 | BIT9 | BIT2 | BIT0
  748. #define VF_NET_GPIO_IO_SEL_VAL_32_63 0x00000000
  749. #define VF_NET_GPIO_IO_SEL_VAL_64_70 0x00000000
  750. #define VF_NET_GPIO_IO_SEL_VAL_SUS 0x00000000
  751. #define VF_NET_GPIO_LVL_VAL_0_31 0x00000000
  752. #define VF_NET_GPIO_LVL_VAL_32_63 0x00000000
  753. #define VF_NET_GPIO_LVL_VAL_64_70 0x00000000
  754. #define VF_NET_GPIO_LVL_VAL_SUS 0x00000000
  755. #define VF_NET_GPIO_TPE_VAL_0_31 0x00000000
  756. #define VF_NET_GPIO_TPE_VAL_SUS 0x00000000
  757. #define VF_NET_GPIO_TNE_VAL_0_31 0x00000000
  758. #define VF_NET_GPIO_TNE_VAL_SUS 0x00000000
  759. #define VF_NET_GPIO_TS_VAL_0_31 0x00000000
  760. #define VF_NET_GPIO_TS_VAL_SUS 0x00000000
  761. //
  762. // Memory space registers
  763. //
  764. //
  765. // CONF0
  766. //
  767. #define VF_NET_PAD_CONF0_GPIO0 0xcd29
  768. #define VF_NET_PAD_CONF0_GPIO1 0xcd29
  769. #define VF_NET_PAD_CONF0_GPIO2 0xcca9
  770. #define VF_NET_PAD_CONF0_GPIO3 0xcca9
  771. #define VF_NET_PAD_CONF0_GPIO4 0xcca8
  772. #define VF_NET_PAD_CONF0_GPIO5 0xcca8
  773. #define VF_NET_PAD_CONF0_GPIO6 0x8d50
  774. #define VF_NET_PAD_CONF0_GPIO7 0x8cd0
  775. #define VF_NET_PAD_CONF0_GPIO8 0x8cd0
  776. #define VF_NET_PAD_CONF0_GPIO9 0x8cd0
  777. #define VF_NET_PAD_CONF0_GPIO10 0x8d50
  778. #define VF_NET_PAD_CONF0_GPIO11 0x8cd0
  779. #define VF_NET_PAD_CONF0_GPIO12 0x8cd0
  780. #define VF_NET_PAD_CONF0_GPIO13 0x8d50
  781. #define VF_NET_PAD_CONF0_GPIO14 0xCCA8
  782. #define VF_NET_PAD_CONF0_GPIO15 0xccaa
  783. #define VF_NET_PAD_CONF0_GPIO16 0xC828
  784. #define VF_NET_PAD_CONF0_GPIO17 0xcd2a
  785. #define VF_NET_PAD_CONF0_GPIO18 0xccaa
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  1081. // PCONF1
  1082. //
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  1094. #define VF_NET_PAD_CONF1_GPIO_SUS11 0
  1095. #define VF_NET_PAD_CONF1_GPIO_SUS12 0
  1096. #define VF_NET_PAD_CONF1_GPIO_SUS13 0
  1097. #define VF_NET_PAD_CONF1_GPIO_SUS14 0
  1098. #define VF_NET_PAD_CONF1_GPIO_SUS15 0
  1099. #define VF_NET_PAD_CONF1_GPIO_SUS16 0
  1100. #define VF_NET_PAD_VAL_GPIO_SUS0 0
  1101. #define VF_NET_PAD_VAL_GPIO_SUS1 0
  1102. #define VF_NET_PAD_VAL_GPIO_SUS2 0
  1103. #define VF_NET_PAD_VAL_GPIO_SUS3 0
  1104. #define VF_NET_PAD_VAL_GPIO_SUS4 0
  1105. #define VF_NET_PAD_VAL_GPIO_SUS5 0
  1106. #define VF_NET_PAD_VAL_GPIO_SUS6 0
  1107. #define VF_NET_PAD_VAL_GPIO_SUS7 0
  1108. #define VF_NET_PAD_VAL_GPIO_SUS8 0
  1109. #define VF_NET_PAD_VAL_GPIO_SUS9 0
  1110. #define VF_NET_PAD_VAL_GPIO_SUS10 0
  1111. #define VF_NET_PAD_VAL_GPIO_SUS11 0
  1112. #define VF_NET_PAD_VAL_GPIO_SUS12 0
  1113. #define VF_NET_PAD_VAL_GPIO_SUS13 0
  1114. #define VF_NET_PAD_VAL_GPIO_SUS14 0
  1115. #define VF_NET_PAD_VAL_GPIO_SUS15 0
  1116. #define VF_NET_PAD_VAL_GPIO_SUS16 0
  1117. #define VF_NET_PAD_DFT_GPIO_SUS0 0
  1118. #define VF_NET_PAD_DFT_GPIO_SUS1 0
  1119. #define VF_NET_PAD_DFT_GPIO_SUS2 0
  1120. #define VF_NET_PAD_DFT_GPIO_SUS3 0
  1121. #define VF_NET_PAD_DFT_GPIO_SUS4 0
  1122. #define VF_NET_PAD_DFT_GPIO_SUS5 0
  1123. #define VF_NET_PAD_DFT_GPIO_SUS6 0
  1124. #define VF_NET_PAD_DFT_GPIO_SUS7 0
  1125. #define VF_NET_PAD_DFT_GPIO_SUS8 0
  1126. #define VF_NET_PAD_DFT_GPIO_SUS9 0
  1127. #define VF_NET_PAD_DFT_GPIO_SUS10 0
  1128. #define VF_NET_PAD_DFT_GPIO_SUS11 0
  1129. #define VF_NET_PAD_DFT_GPIO_SUS12 0
  1130. #define VF_NET_PAD_DFT_GPIO_SUS13 0
  1131. #define VF_NET_PAD_DFT_GPIO_SUS14 0
  1132. #define VF_NET_PAD_DFT_GPIO_SUS15 0
  1133. #define VF_NET_PAD_DFT_GPIO_SUS16 0
  1134. //
  1135. // Function Prototypes
  1136. //
  1137. EFI_STATUS
  1138. PlatformPchInit (
  1139. IN SYSTEM_CONFIGURATION *SystemConfiguration,
  1140. IN CONST EFI_PEI_SERVICES **PeiServices,
  1141. IN UINT16 PlatformType
  1142. );
  1143. EFI_STATUS
  1144. PlatformCpuInit (
  1145. IN CONST EFI_PEI_SERVICES **PeiServices,
  1146. IN SYSTEM_CONFIGURATION *SystemConfiguration,
  1147. IN EFI_PLATFORM_CPU_INFO *PlatformCpuInfo
  1148. );
  1149. EFI_STATUS
  1150. PeimInitializeFlashMap (
  1151. IN EFI_FFS_FILE_HEADER *FfsHeader,
  1152. IN CONST EFI_PEI_SERVICES **PeiServices
  1153. );
  1154. EFI_STATUS
  1155. PeimInstallFlashMapPpi (
  1156. IN EFI_FFS_FILE_HEADER *FfsHeader,
  1157. IN CONST EFI_PEI_SERVICES **PeiServices
  1158. );
  1159. EFI_STATUS
  1160. EFIAPI
  1161. IchReset (
  1162. IN CONST EFI_PEI_SERVICES **PeiServices
  1163. )
  1164. ;
  1165. BOOLEAN
  1166. GetSleepTypeAfterWakeup (
  1167. IN CONST EFI_PEI_SERVICES **PeiServices,
  1168. OUT UINT16 *SleepType
  1169. );
  1170. EFI_STATUS
  1171. EFIAPI
  1172. GetWakeupEventAndSaveToHob (
  1173. IN CONST EFI_PEI_SERVICES **PeiServices
  1174. )
  1175. ;
  1176. EFI_STATUS
  1177. EFIAPI
  1178. MemoryDiscoveredPpiNotifyCallback (
  1179. IN CONST EFI_PEI_SERVICES **PeiServices,
  1180. IN EFI_PEI_NOTIFY_DESCRIPTOR *NotifyDescriptor,
  1181. IN VOID *Ppi
  1182. )
  1183. ;
  1184. EFI_STATUS
  1185. EFIAPI
  1186. PeiGetVariable (
  1187. IN CONST EFI_PEI_SERVICES **PeiServices,
  1188. IN CHAR16 *VariableName,
  1189. IN EFI_GUID * VendorGuid,
  1190. OUT UINT32 *Attributes OPTIONAL,
  1191. IN OUT UINTN *DataSize,
  1192. OUT VOID *Data
  1193. )
  1194. ;
  1195. EFI_STATUS
  1196. EFIAPI
  1197. PeiGetNextVariableName (
  1198. IN CONST EFI_PEI_SERVICES **PeiServices,
  1199. IN OUT UINTN *VariableNameSize,
  1200. IN OUT CHAR16 *VariableName,
  1201. IN OUT EFI_GUID *VendorGuid
  1202. )
  1203. ;
  1204. EFI_STATUS
  1205. UpdateBootMode (
  1206. IN CONST EFI_PEI_SERVICES **PeiServices,
  1207. IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob
  1208. );
  1209. EFI_STATUS
  1210. EFIAPI
  1211. EndOfPeiPpiNotifyCallback (
  1212. IN CONST EFI_PEI_SERVICES **PeiServices,
  1213. IN EFI_PEI_NOTIFY_DESCRIPTOR *NotifyDescriptor,
  1214. IN VOID *Ppi
  1215. );
  1216. EFI_STATUS
  1217. EFIAPI
  1218. PeimInitializeRecovery (
  1219. IN CONST EFI_PEI_SERVICES **PeiServices
  1220. )
  1221. ;
  1222. VOID
  1223. CheckPowerOffNow (
  1224. VOID
  1225. );
  1226. VOID
  1227. IchGpioInit (
  1228. IN UINT16 PlatformType,
  1229. IN SYSTEM_CONFIGURATION *SystemConfiguration
  1230. );
  1231. EFI_STATUS
  1232. PcieSecondaryBusReset (
  1233. IN CONST EFI_PEI_SERVICES **PeiServices,
  1234. IN UINT8 Bus,
  1235. IN UINT8 Dev,
  1236. IN UINT8 Fun
  1237. );
  1238. VOID
  1239. SetPlatformBootMode (
  1240. IN CONST EFI_PEI_SERVICES **PeiServices,
  1241. IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob
  1242. );
  1243. BOOLEAN
  1244. CheckIfJumperSetForRecovery(
  1245. VOID
  1246. );
  1247. BOOLEAN
  1248. IsA16Inverted (
  1249. );
  1250. EFI_STATUS
  1251. EFIAPI
  1252. InitLan (
  1253. IN CONST EFI_PEI_SERVICES **PeiServices,
  1254. IN SYSTEM_CONFIGURATION *Buffer
  1255. );
  1256. EFI_STATUS
  1257. EFIAPI
  1258. Stall (
  1259. IN CONST EFI_PEI_SERVICES **PeiServices,
  1260. IN CONST EFI_PEI_STALL_PPI *This,
  1261. IN UINTN Microseconds
  1262. );
  1263. EFI_STATUS
  1264. MultiPlatformInfoInit (
  1265. IN CONST EFI_PEI_SERVICES **PeiServices,
  1266. IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob
  1267. );
  1268. BOOLEAN
  1269. IsRecoveryJumper (
  1270. IN CONST EFI_PEI_SERVICES **PeiServices,
  1271. IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob
  1272. );
  1273. EFI_STATUS
  1274. CheckOsSelection (
  1275. IN CONST EFI_PEI_SERVICES **PeiServices,
  1276. IN SYSTEM_CONFIGURATION *SystemConfiguration
  1277. );
  1278. EFI_STATUS
  1279. PlatformInfoUpdate (
  1280. IN CONST EFI_PEI_SERVICES **PeiServices,
  1281. IN OUT EFI_PLATFORM_INFO_HOB *PlatformInfoHob,
  1282. IN SYSTEM_CONFIGURATION *SystemConfiguration
  1283. );
  1284. VOID
  1285. PlatformSsaInit (
  1286. IN SYSTEM_CONFIGURATION *SystemConfiguration,
  1287. IN CONST EFI_PEI_SERVICES **PeiServices
  1288. );
  1289. EFI_STATUS
  1290. InitializePlatform (
  1291. IN CONST EFI_PEI_SERVICES **PeiServices,
  1292. IN EFI_PLATFORM_INFO_HOB *PlatformInfoHob,
  1293. IN SYSTEM_CONFIGURATION *SystemConfiguration
  1294. );
  1295. VOID
  1296. MchInit (
  1297. IN CONST EFI_PEI_SERVICES **PeiServices
  1298. );
  1299. EFI_STATUS
  1300. EFIAPI
  1301. SetPeiCacheMode (
  1302. IN CONST EFI_PEI_SERVICES **PeiServices
  1303. );
  1304. EFI_STATUS
  1305. EFIAPI
  1306. SetDxeCacheMode (
  1307. IN CONST EFI_PEI_SERVICES **PeiServices
  1308. );
  1309. BOOLEAN
  1310. IsRtcUipAlwaysSet (
  1311. IN CONST EFI_PEI_SERVICES **PeiServices
  1312. );
  1313. EFI_STATUS
  1314. InitPchUsb (
  1315. IN CONST EFI_PEI_SERVICES **PeiServices
  1316. );
  1317. EFI_STATUS
  1318. EFIAPI
  1319. PublishMemoryTypeInfo (
  1320. void
  1321. );
  1322. #endif