/* SPDX-License-Identifier: GPL-2.0-or-later */ /** ****************************************************************************** * @file ezGPIO_fullMux_ctrl_macro.h * @author StarFive Technology * @version V1.0 * @date 06/25/2020 * @brief ****************************************************************************** * @copy * * THE PRESENT SOFTWARE WHICH IS FOR GUIDANCE ONLY AIMS AT PROVIDING CUSTOMERS * WITH CODING INFORMATION REGARDING THEIR PRODUCTS IN ORDER FOR THEM TO SAVE * TIME. AS A RESULT, STARFIVE SHALL NOT BE HELD LIABLE FOR ANY * DIRECT, INDIRECT OR CONSEQUENTIAL DAMAGES WITH RESPECT TO ANY CLAIMS ARISING * FROM THE CONTENT OF SUCH SOFTWARE AND/OR THE USE MADE BY CUSTOMERS OF THE * CODING INFORMATION CONTAINED HEREIN IN CONNECTION WITH THEIR PRODUCTS. * * COPYRIGHT 2020 Shanghai StarFive Technology Co., Ltd. */ #ifndef _EZGPIO_FULLMUX_MACRO_H_ #define _EZGPIO_FULLMUX_MACRO_H_ //#define EZGPIO_FULLMUX_BASE_ADDR 0x0 #define gpioen_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x0 #define gpio_0_dout_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x50 #define gpio_0_doen_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x54 #define gpio_1_dout_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x58 #define gpio_1_doen_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x5C #define gpio_2_dout_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x60 #define gpio_2_doen_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x64 #define gpio_3_dout_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x68 #define gpio_3_doen_REG_ADDR EZGPIO_FULLMUX_BASE_ADDR + 0x6C #define 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_ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ 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_ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_0_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cdata_out_bit0 { \ uint32_t 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#define SET_GPIO_0_doen_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_0_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_0_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_0_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ 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\ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ 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SET_GPIO_1_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_1_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ 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\ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ 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SET_GPIO_1_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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SET_GPIO_1_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ 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#define SET_GPIO_1_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ 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#define SET_GPIO_1_doen_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_1_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_1_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_1_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ 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(0x7&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ 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_ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ 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|= (0x31&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ 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#define SET_GPIO_2_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_2_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ 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_ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_2_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_2_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_2_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= 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\ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ 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SET_GPIO_3_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_3_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ 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|= (0x1B&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= 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#define SET_GPIO_3_doen_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ 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_ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_3_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_3_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_3_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ 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SET_GPIO_4_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_4_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= 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_ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_oe_bit5 { \ uint32_t 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#define SET_GPIO_4_doen_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_4_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_4_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_4_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ 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SET_GPIO_5_dout_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_5_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= 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#define SET_GPIO_5_doen_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ 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\ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ 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SET_GPIO_5_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_5_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_5_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_5_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ 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&= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ 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SET_GPIO_6_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ 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\ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= 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_ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_6_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ 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SET_GPIO_6_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_6_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_6_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_6_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_7_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ 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SET_GPIO_7_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ 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_ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_7_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_7_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_7_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ 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(0x6&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ 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#define SET_GPIO_8_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_8_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ 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\ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ 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SET_GPIO_8_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ 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#define SET_GPIO_8_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x69&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_8_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_8_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_8_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ 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#define SET_GPIO_9_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi2_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6E&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi2_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6F&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi2ahb_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x70&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi2ahb_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_9_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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#define SET_GPIO_9_doen_sdio1_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x57&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio1_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x58&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio1_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x59&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_sdio1_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ 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SET_GPIO_9_doen_spi1_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6A&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6B&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6C&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6D&0xFF); \ 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_ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_9_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_9_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_9_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_10_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_10_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_10_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_10_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_10_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_10_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_10_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_11_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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SET_GPIO_11_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_11_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_11_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_11_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_11_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_12_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio0_pad_cdata_out_bit7 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_12_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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SET_GPIO_12_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_12_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_12_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_12_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_12_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_13_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_13_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_13_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_13_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_13_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ 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SET_GPIO_14_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_14_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_14_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_14_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_14_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_14_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_14_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_15_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_15_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_15_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_15_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_15_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_15_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_doen_HIGH { \ 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SET_GPIO_15_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_15_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_15_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_15_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_15_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_15_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_15_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_15_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_15_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_16_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_16_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_16_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_16_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_16_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t 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SET_GPIO_16_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_16_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_16_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_16_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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SET_GPIO_17_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_17_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_17_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_17_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_17_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_17_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_17_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_17_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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SET_GPIO_17_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_17_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_17_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_17_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define 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SET_GPIO_18_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_18_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_18_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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SET_GPIO_18_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_18_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_18_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_18_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_18_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_18_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_18_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_19_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_19_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_19_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_19_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_19_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_20_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio0_pad_cdata_out_bit7 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_20_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_20_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_20_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_20_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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_ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_21_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_21_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_21_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_21_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_22_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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_ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_22_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_22_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_22_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_23_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_sdio0_pad_cdata_out_bit7 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SET_GPIO_23_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_23_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_23_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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&= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_sdio1_pad_cdata_oe_bit5 { \ uint32_t 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_23_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_23_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_23_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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SET_GPIO_24_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_24_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_24_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_24_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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SET_GPIO_24_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_24_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_24_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_24_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_24_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_25_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_25_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_25_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ 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SET_GPIO_25_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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#define SET_GPIO_25_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_25_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_25_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_25_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_26_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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&= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_sdio1_pad_rst_n { \ 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SET_GPIO_26_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_26_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_26_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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#define SET_GPIO_26_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_26_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_26_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_26_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_27_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_27_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_27_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_27_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_27_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_27_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_28_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_sdio0_pad_cdata_out_bit7 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_28_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_28_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_28_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_28_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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_ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_29_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_29_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_29_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_29_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_30_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_30_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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_ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_30_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_30_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_30_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_31_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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SET_GPIO_31_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_31_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_31_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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&= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_sdio1_pad_cdata_oe_bit5 { \ uint32_t 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SET_GPIO_31_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_31_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_31_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_31_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_31_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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SET_GPIO_32_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_32_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_32_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_32_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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SET_GPIO_32_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_32_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_32_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_32_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_32_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_33_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_33_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_33_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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#define SET_GPIO_33_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_33_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_33_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_33_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_34_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_34_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_34_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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&= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_sdio1_pad_rst_n { \ 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SET_GPIO_34_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_34_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_34_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_34_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_34_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_34_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_34_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_35_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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SET_GPIO_35_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_35_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_35_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_35_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_35_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_35_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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SET_GPIO_36_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_sdio0_pad_cdata_out_bit7 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_36_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_36_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_36_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_36_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_36_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_36_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_37_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_37_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_37_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_37_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ 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SET_GPIO_38_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_38_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ 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_ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_38_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_38_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_38_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_38_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_39_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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SET_GPIO_39_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_39_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_39_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_39_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_39_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_doen_HIGH { \ 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SET_GPIO_39_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_39_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_39_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_39_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_39_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_39_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_39_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_39_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_39_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_40_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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SET_GPIO_40_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_40_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_40_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_40_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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SET_GPIO_40_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_40_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_40_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_40_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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SET_GPIO_41_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_41_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_41_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ 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SET_GPIO_41_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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#define SET_GPIO_41_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_41_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_41_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_41_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_42_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_42_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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&= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_42_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_42_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_42_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_42_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_42_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_42_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_42_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_42_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_43_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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SET_GPIO_43_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_43_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_43_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_43_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_43_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_44_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_sdio0_pad_cdata_out_bit7 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_44_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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SET_GPIO_44_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_44_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_44_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_44_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_44_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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_ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_45_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_45_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_45_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_45_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_45_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ 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SET_GPIO_46_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_46_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_46_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_46_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_46_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_46_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_47_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_47_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_47_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_47_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_47_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_47_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_47_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_47_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_47_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_47_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_47_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_47_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_47_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_i2srx_mclk_out { \ uint32_t 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SET_GPIO_48_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_48_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_48_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_48_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_48_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_48_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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SET_GPIO_48_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_48_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_48_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_48_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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SET_GPIO_49_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_49_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_49_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_49_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_49_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_49_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_49_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_49_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_49_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_49_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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SET_GPIO_49_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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#define SET_GPIO_49_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_49_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_49_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_49_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_50_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_50_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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&= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_sdio1_pad_rst_n { \ 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SET_GPIO_50_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_50_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_50_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_50_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_50_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_50_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_50_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_51_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_51_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_51_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_51_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_51_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_51_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_52_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio0_pad_cdata_out_bit7 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_52_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_52_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_52_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_52_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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_ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_53_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_53_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_sdio0_pad_cdata_out_bit7 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_53_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_53_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_53_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ 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SET_GPIO_54_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_54_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_54_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_54_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_54_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_55_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_55_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_55_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_55_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_HIGH { \ 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SET_GPIO_55_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_55_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_55_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_55_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_55_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_56_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_56_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi3_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x79&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi3_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7A&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi3_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7B&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_spi3_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_56_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_56_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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SET_GPIO_56_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_56_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_56_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_56_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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SET_GPIO_57_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_57_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_57_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_57_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_57_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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SET_GPIO_57_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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#define SET_GPIO_57_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_57_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_57_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_57_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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SET_GPIO_58_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_58_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_58_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2E&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_qspi_csn1_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2F&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_qspi_csn2_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x30&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_qspi_csn3_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x31&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_register23_SCFG_cmsensor_rst0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x36&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x37&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x38&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x41&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x42&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x43&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ 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&= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_58_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_58_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_58_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_58_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_58_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_58_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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SET_GPIO_59_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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SET_GPIO_59_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_59_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_59_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_59_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_59_doen_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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SET_GPIO_60_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3D&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio0_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3E&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio0_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3F&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio0_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x40&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio0_pad_cdata_out_bit7 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5A&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio1_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5B&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio1_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5C&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio1_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5D&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_sdio1_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_60_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x44&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio0_pad_cdata_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x45&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio0_pad_cdata_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x46&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio0_pad_cdata_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x47&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio0_pad_cdata_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_60_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ |= (0x7C&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_uart0_pad_dtrn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7D&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_uart0_pad_rtsn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7E&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_uart0_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7F&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_uart1_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_60_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_60_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_60_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_out_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2B&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwm_pad_out_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2C&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwmdac_left_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2D&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_pwmdac_right_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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~(0xFF); \ _ezchip_macro_read_value_ |= (0x39&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_sdio0_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3A&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_sdio0_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3B&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_sdio0_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3C&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_sdio0_pad_cdata_oe_bit4 { \ uint32_t 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_ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_61_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi1_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x66&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi1_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x67&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi1_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x68&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi1_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_61_doen_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_61_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_61_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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_ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ 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_ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x32&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_register23_SCFG_cmsensor_rst1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x33&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_register32_SCFG_gmac_phy_rstn { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x34&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio0_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x35&0xFF); \ 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{ \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x48&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio0_pad_rst_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x49&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_card_power_en { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4A&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4B&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_ccmd_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4C&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_ccmd_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4D&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_oe_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4E&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_oe_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4F&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_oe_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x50&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_oe_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x51&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_oe_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x52&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_oe_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x53&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_oe_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x54&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_oe_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x55&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_sdio1_pad_cdata_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x56&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5E&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spdif_tx_sdout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5F&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spdif_tx_sdout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x60&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi0_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x61&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x80&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_uart2_pad_dtr_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x81&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_uart2_pad_rts_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x82&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_uart2_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x83&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_uart3_pad_sout { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_62_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2c0_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x9&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2c1_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xA&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2c1_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xB&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2c2_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xC&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2c2_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xD&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2c3_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xE&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2c3_pad_sda_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0xF&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2srx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x10&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2srx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x11&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2srx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x12&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2srx_lrck_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x13&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2srx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x14&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2stx_bclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x15&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2stx_bclk_out_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x16&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2stx_lrck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x17&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_lcd_pad_csm_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1C&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_oe_n_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1D&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_oe_n_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1E&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1F&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x20&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_oe_n_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x21&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_oe_n_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x22&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_oe_n_bit6 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x71&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_spi2ahb_pad_oe_n_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x72&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_spi2ahb_pad_oe_n_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x73&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_spi2ahb_pad_txd_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x74&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_62_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_62_doen_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_62_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_63_dout_i2stx_lrckout_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x18&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_i2stx_mclk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x19&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_i2stx_sdout0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1A&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_i2stx_sdout1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1B&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x23&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_pwm_pad_oe_n_bit7 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x24&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_pwm_pad_out_bit0 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x25&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_pwm_pad_out_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x26&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_pwm_pad_out_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x27&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_pwm_pad_out_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x28&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_pwm_pad_out_bit4 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x29&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_pwm_pad_out_bit5 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2A&0xFF); \ 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SET_GPIO_63_dout_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_63_dout_spi2ahb_pad_txd_bit1 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x75&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_spi2ahb_pad_txd_bit2 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x76&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_spi2ahb_pad_txd_bit3 { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x77&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_spi3_pad_oe_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x78&0xFF); \ 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_ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x84&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_dout_usb_drv_bus { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_dout_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x85&0xFF); \ MA_OUTW(gpio_63_dout_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_reverse_(en) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0x1<<31); \ _ezchip_macro_read_value_ |= (en&0x1)<<31; \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_LOW { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x0&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_HIGH { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x1&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_clk_gmac_tophyref { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x2&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_cpu_jtag_tdo { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x3&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_cpu_jtag_tdo_oen { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x4&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_dmic_clk_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x5&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_dsp_JTDOEn_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x6&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_dsp_JTDO_pad { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x7&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_i2c0_pad_sck_oe { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x8&0xFF); \ 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SET_GPIO_63_doen_spi0_pad_sck_out { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x62&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_spi0_pad_ss_0_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x63&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_spi0_pad_ss_1_n { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x64&0xFF); \ MA_OUTW(gpio_63_doen_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_63_doen_spi0_pad_txd { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_63_doen_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= (0x65&0xFF); \ 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#define SET_GPIO_cpu_jtag_tms(gpio) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_cpu_jtag_tms_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= ((gpio+2)&0xFF); \ MA_OUTW(gpio_cpu_jtag_tms_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_cpu_jtag_trst(gpio) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_cpu_jtag_trst_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= ((gpio+2)&0xFF); \ MA_OUTW(gpio_cpu_jtag_trst_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_dmic_sdin_bit0(gpio) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_dmic_sdin_bit0_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= ((gpio+2)&0xFF); \ MA_OUTW(gpio_dmic_sdin_bit0_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_dmic_sdin_bit1(gpio) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_dmic_sdin_bit1_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= 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SET_GPIO_spi3_pad_rxd(gpio) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_spi3_pad_rxd_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= ((gpio+2)&0xFF); \ MA_OUTW(gpio_spi3_pad_rxd_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_spi3_pad_ss_in_n(gpio) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_spi3_pad_ss_in_n_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= ((gpio+2)&0xFF); \ MA_OUTW(gpio_spi3_pad_ss_in_n_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_uart0_pad_ctsn(gpio) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_uart0_pad_ctsn_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= ((gpio+2)&0xFF); \ MA_OUTW(gpio_uart0_pad_ctsn_REG_ADDR,_ezchip_macro_read_value_); \ } #define SET_GPIO_uart0_pad_dcdn(gpio) { \ uint32_t _ezchip_macro_read_value_=MA_INW(gpio_uart0_pad_dcdn_REG_ADDR); \ _ezchip_macro_read_value_ &= ~(0xFF); \ _ezchip_macro_read_value_ |= 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